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VHDL/FPGA/Verilog 8194个

m序列在dspbuilder下产生VHDL源码及其测试激励文件的matlab模型,在modelsim下仿真通过

标签: dspbuilder modelsim matlab VHDL 发布者:LotusAwhaT上传时间:2015-06-27
辛辛苦苦的作品应用于DE2 的开发。。希望对大家有用。

标签: DE2 应用于家发布者:rain0413上传时间:2015-06-27
该代码为配合7号信令模块MK50H27的cpld(xilinx 95144)的逻辑代码,其中包括了VHDL及原理图.

标签: xilinx 95144 cpld VHDL 发布者:lihuitao1987上传时间:2015-06-27
VHDL语言编写的FIR滤波器源码对于嵌入式设计者有很好的指导作用

标签: VHDL FIR 语言编写发布者:as7512158上传时间:2015-06-27
JOP的内核文件

标签: JOP 内核发布者:cz6891297上传时间:2015-06-27
JOP的RAM VHDL源码

标签: VHDL JOP RAM 源码发布者:RSY527上传时间:2015-06-27
sram 读写小程序

标签: sram 读写程序发布者:zergwyk上传时间:2015-06-25
一个用VHDL完成的8位数显的16进制的频率计

标签: VHDL 8位数显进制发布者:yamiluoier上传时间:2015-06-25
24秒倒计时系统（有跑马灯）利用CPLD

标签: CPLD 计时系统跑马灯发布者:lingyun579上传时间:2015-06-24
//led.v /*------------------------------------- LED显示模块：led(CLK,AF,ADDR,DATA) 功能：显示注意事项： 8位L

标签: led ADDR DATA LED 发布者:zhiver上传时间:2015-06-24
用VHDL写的计算器

标签: VHDL 计算器发布者:jill上传时间:2015-06-24
CORDIC算法的硬件实现用的verilog语言

标签: verilog CORDIC 算法硬件实现发布者:captainjn上传时间:2015-06-24
第7章数字系统设计实例 7.1 半整数分频器的设计 7.2 音乐发生器 7.3 2FSK/2PSK信号产生器 7.4 实用多功能电子表 7.5 交通灯控制器 7.6 数字频率计

标签: 7.1 7.2 7.3 FSK 发布者:budyang上传时间:2015-06-23
FPGA与DSP的EMIFA口接口程序.在FPGA内分配了两块双BUFFER与DSP进行通信.

标签: FPGA DSP BUFFER EMIFA 发布者:xiao11tian上传时间:2015-06-23
用verilog写的cpld的各种分频程序

标签: verilog cpld 分频程序发布者:starsrain1上传时间:2015-06-23
ModelSim的波形比较的功能可以将当前仿真与一个参考数据（WLF文件）进行比较

标签: ModelSim WLF 比较波形发布者:balefu123上传时间:2015-06-23
FPGA/CPLD应用,uart通讯VHDL原码.

标签: FPGA CPLD uart VHDL 发布者:wxsara1118上传时间:2015-06-23
HDL编程风格

标签: HDL 编程发布者:archimedes88上传时间:2015-06-23
一个用Verilog编写的编帧、解帧及码速匹配的程序

标签: Verilog 帧编写程序发布者:feiguohaihu上传时间:2015-06-22
用walsh算法实现的符号数乘法器,asic流片时,可以不用公司的付费乘法器的ip core.

标签: walsh asic core 乘法器发布者:gxjun686上传时间:2015-06-22
四位全家器的VHDL语言模块

标签: VHDL 家语言模块发布者:sunny_02上传时间:2015-06-21
四位十进制频率计的顶层控制模块

标签: 十进制频率计控制模块发布者:suroot2005上传时间:2015-06-21
一些vhdl的简单例子。直接解压

标签: vhdl 解压发布者:liyusheng1983上传时间:2015-06-21
用于实现两个数相加的vhdl代码

标签: vhdl 代码发布者:xukejia上传时间:2015-06-21
关于一个串行数据输入根据时序将数据分两路输出的程序

标签: 串行数据输入时序数据发布者:ludingpc上传时间:2015-06-21
关于两种实现pwm的方法基于51单片机设计

标签: pwm 51单片机发布者:goocool上传时间:2015-06-21
lgpl RS编解码 5-6 Reed-Solomon Codes

标签: Reed-Solomon Codes lgpl RS编解码发布者:wldxmy上传时间:2015-06-20
风格非常好一六位计数器无密码质量很高

标签: 计数器密码质量发布者:shicg666666上传时间:2015-06-20
本文件是altera公司fpga的ip核

标签: altera fpga 发布者:WOKAORIPI上传时间:2015-06-20
元件例化与层次设计

标签: 元件层次设计发布者:liu4052032上传时间:2015-06-19