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V 的代码
dct.v
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//// Discrete Cosine Transform, Parallel implementation
dctub.v
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//// Discrete Cosine Transform, DCT unit block
zigzag.v
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//// Zig-Zag Unit
fdct.v
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//// Forward Discrete Cosine Transform and ZigZag unit
dctu.v
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//// Discrete Cosine Transform Unit
timescale.v
`timescale 1ns / 10ps
div.v
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//// Non-restoring singed dividor
decode.v
module decode(addr,addr_data,ALE_E,PSEN_N,reg_en,addr_match);
input [15:8] addr;
inout [7:0] addr_data;
input ALE_E;
input PSEN_N;
output addr_match;
//wire addr_
send.v
module send(clock,txd,key_send);
//9600BPS,8位数据,1位停止位
input clock;
input [7:0] key_send;
output txd;
reg key_start;
reg txd_reg; //发送寄存器
reg [10:0] count; //分频系数控制(9600bps=11.05
receive.v
module receive(rxd,clock,sbuf);
//9600BPS,8位数据,1位停止位
input rxd;
input clock;
output [7:0] sbuf;
reg [3:0] count_reg; //RXD数据状态计数器
reg [9:0] uart_buf; //串行数据接收缓冲区
reg [3:0] bit_