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这是一个利用MAX PULL 制作的VHDL的全加器的程序如果有需要仿真图的请叫站长联系我...

📅 2016-07-30

这是一个利用MAX PULL 制作的VHDL的四位全加器的程序如果有需要仿真图的请叫站长联系我...

📅 2014-05-31

数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状态机、2-1路选择器的源代码...

📅 2014-01-06

全加器，全加器，全加器...

📅 2016-11-26

半加器或门 1位二进制全加器顶层设计描述...

📅 2014-01-03

一个全加器的VHDL程序,经过编译和仿真....

📅 2013-12-24

基于eda中vhdl语言的一位全加器的设计，详细的设计过程和实验现象，相互学习...

📅 2014-01-15

此程序是用VHDL硬件描述语言编写的,实现四位全加器的功能...

📅 2017-01-07

1位全加器的vhdl设计通过两个半加起实现...

📅 2017-01-12

这是我在ISP编程实验中独立编写的采用结构化描述的四位全加器，通过四次映射一位全加器的方式实现了四位全加器的功能，并附有数码显示模块，将全加器的运算结果输出到数码管显示。...

📅 2017-01-19

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