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数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状
数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状态机、2-1路选择器的源代码
VHDL/FPGA/Verilog
881 K
173 次下载
2014-01-06
资源详细信息
文件格式
压缩包
文件大小
881 K
资源分类
VHDL/FPGA/Verilog
上传者
kight521
发布时间
2014-01-06 10:49
下载统计
173
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数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状态机、2-1路选择器的源代码 - 资源详细说明
数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状态机、2-1路选择器的源代码
数字系统设计中的全加器、10进制计数器、2-4译码器、摩尔状态机、2-1路选择器的源代码 - 源码文件列表
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allplus.fit.rpt
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waveform1.vwf
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allplus.tan.rpt
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