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VHDL/FPGA/Verilog 用verlog HDL写的电子日历,可以显示年,月,日和时间,具有闹铃的功能
用verlog HDL写的电子日历,可以显示年,月,日和时间,具有闹铃的功能
VHDL/FPGA/Verilog 使用FPGA控制蜂鸣器的程序,用Verilog HDL设计,可以是蜂鸣器发出各种不同的声音
使用FPGA控制蜂鸣器的程序,用Verilog HDL设计,可以是蜂鸣器发出各种不同的声音
VHDL/FPGA/Verilog 该工程是基于verilog hdl 语言编写的帧传输协议HDLC帧的发送端代码
该工程是基于verilog hdl 语言编写的帧传输协议HDLC帧的发送端代码，会用QUATUSII的人都应该知道如何使用，希望能给你带来帮助
VHDL/FPGA/Verilog 用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序
用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序
VHDL/FPGA/Verilog VerilogHDL_advanced_digital_design_code_Ch6 Verilog HDL 高级数字设计源码ch6
VerilogHDL_advanced_digital_design_code_Ch6
Verilog HDL 高级数字设计源码ch6
VHDL/FPGA/Verilog VerilogHDL_advanced_digital_design_code_Ch7 Verilog HDL 高级数字设计 源码ch7
VerilogHDL_advanced_digital_design_code_Ch7
Verilog HDL 高级数字设计 源码ch7
VHDL/FPGA/Verilog 是几个用Verilog HDL语言编写的源代码（里面包括实现滤波器等）
是几个用Verilog HDL语言编写的源代码（里面包括实现滤波器等），对想学习这个语言的朋友很有帮助！
VHDL/FPGA/Verilog 此程序为用VERLOG HDL编写的一个完整的3位加法器。
此程序为用VERLOG HDL编写的一个完整的3位加法器。
VHDL/FPGA/Verilog 用verillog HDL 写的数字频率计.在实验箱上测试通过
用verillog HDL 写的数字频率计.在实验箱上测试通过
VHDL/FPGA/Verilog 用v-hdl写的基于fpga的串口驱动程序希望对大家有帮助
用v-hdl写的基于fpga的串口驱动程序希望对大家有帮助