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是几个用Verilog HDL语言编写的源代码（里面包括实现滤波器等）

VHDL/FPGA/Verilog 15 K 82 次下载 2016-05-22

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RAR

文件大小

15 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2016-05-22 20:42

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82 次

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2 积分

是几个用Verilog HDL语言编写的源代码（里面包括实现滤波器等） - 资源详细说明

是几个用Verilog HDL语言编写的源代码（里面包括实现滤波器等），对想学习这个语言的朋友很有帮助！

是几个用Verilog HDL语言编写的源代码（里面包括实现滤波器等） - 源码文件列表

本资源包含 20 个源码文件支持在线预览，点击文件名即可查看

1

decimation.v

2

test_par_fir.v

3

文件列表.txt

4

integrator_par.v

5

mul4b_addtree.v

6

fir.v

7

mul4b_shiftadd_fsm.v

8

interpolation.v

9

full_adder.v

10

ser_fir.v

11

pipe_adder8b.v

12

sincos.v

13

differentiator.v

14

ripple_adder4b.v

15

par_fir.v

查看完整源码列表 (共 20 个文件) →

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