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用verillog HDL 写的数字频率计.在实验箱上测试通过

VHDL/FPGA/Verilog 13 K 163 次下载 2013-12-28

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RAR

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13 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2013-12-28 20:23

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用verillog HDL 写的数字频率计.在实验箱上测试通过 - 资源详细说明

用verillog HDL 写的数字频率计.在实验箱上测试通过

用verillog HDL 写的数字频率计.在实验箱上测试通过 - 源码文件列表

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1

block2.bdf

2

count.bsf

3

block2.qpf

4

suocun.bsf

5

fenwei.bsf

6

fenwei.v

7

fenpin.v

8

fenpin.bsf

9

scan.v

10

scan.bsf

11

suocun.v

12

dec.v

13

count.v

14

dec.bsf

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