四位等精度频率计，基于Verilog HDL的设计。
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FILE
divstream.v
485 B
包内组件
2
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tendiv4.v
308 B
包内组件
3
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dff.v
143 B
包内组件
4
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freq_m_1.v
2.9 KB
包内组件
5
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tendiv.v
231 B
包内组件
6
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gen_seq.v
624 B
包内组件