4位数字频率计的verilog HDL设计，精度比较准的
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FILE
fp4hz.bsf
1.5 KB
包内组件
2
FILE
one.map.summary
268 B
包内组件
3
FILE
latch_16.bsf
1.7 KB
包内组件
4
FILE
one.map.smsg
252 B
包内组件
5
FILE
one.cdf
277 B
包内组件
6
FILE
one.qpf
903 B
包内组件
7
FILE
latch_16.v
164 B
包内组件
8
FILE
fp4hz.v
237 B
包内组件
9
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fp50hz.bsf
1.6 KB
包内组件
10
FILE
count10.v
362 B
包内组件
11
FILE
ctr.v.bak
541 B
包内组件
12
FILE
one.pof
207.1 KB
包内组件