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是Nios II處理器下客製化指令的一個32位元浮點數除法器

VHDL/FPGA/Verilog 19 K 85 次下载 2014-01-21

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19 K

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VHDL/FPGA/Verilog

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2014-01-21 18:13

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是Nios II處理器下客製化指令的一個32位元浮點數除法器 - 资源详细说明

是Nios II處理器下客製化指令的一個32位元浮點數除法器，可將兩IEEE 754格式的值進行相除

是Nios II處理器下客製化指令的一個32位元浮點數除法器 - 源码文件列表

本资源包含 24 个源码文件支持在线预览，点击文件名即可查看

1

sum28_shell.vhd

2

csa_2weight.vhd

3

words.vhd

4

rca_20bit.vhd

5

fpdivider24_v1.vhd

6

mult_ax.vhd

7

fpdivider24.vhd

8

mult_sub24_1bx.vhd

9

conv.vhd

10

fpdiv_32.vhd

11

msub24_1bx_shell.vhd

12

vish_stacktrace.vstf

13

fa_1bit.vhd

14

table.vhd

15

table_shell.vhd

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