💻 這是一個二維的上提式9/7離散小波的Verilog的源碼,此為Encoder - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 counter_state.v
975 B
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2
📄 counter_128bits.v
662 B
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3
📄 fdwt_all.csf.rpt
64 KB
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4
📄 coff_r.v
1003 B
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5
📄 release.fsf
461 B
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6
📄 pctofpga.v
4.46 KB
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7
📃 serv_req_info.txt
103 B
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8
📄 bidirec.v
459 B
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9
📄 fdwt_all.qws
344 B
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10
📄 fdwt_all.v
4.93 KB
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11
📄 idwt97_datapath.v
3.66 KB
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12
📄 fdwt_all.csf
8.91 KB
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13
📄 register_i.v
540 B
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14
📄 memory_inst.v
138 B
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15
📄 fdwt_all.pof
0 B
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16
📄 fdwt_all.vwf
57.81 KB
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17
📄 register_f.v
540 B
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18
📄 idwt97_top.v
1.06 KB
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19
📄 chang3to2.v
724 B
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20
📄 coff_l.v
1.19 KB
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21
📄 fdwt_all.sof
0 B
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22
📄 idwt97_control.v
869 B
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23
📄 coff_b.v
873 B
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24
📄 fdwt97_top.v
1.07 KB
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25
📄 controlpath.v
10.61 KB
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26
📄 fdwt97_datapath.v
3.46 KB
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27
📄 fdwt_all_2.pof
0 B
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28
📄 memory.v
4.96 KB
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29
📄 sel_level.v
2.71 KB
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30
📄 coff_a.v
1.1 KB
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31
📄 fdwt97_control.v
1.15 KB
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32
📄 datapath.v
3.89 KB
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33
📄 fdwt_all.pin
48.91 KB
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34
📄 fdwt_all.ssf.rpt
7.2 KB
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35
📄 pctofpga.verilogview
0 B
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36
📄 coff_a.verilogview
0 B
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37
📄 fdwt_all.fdwt_all.csf.hdb
0 B
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38
📄 fdwt_all.fdwt_all.ssf.rdb
0 B
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39
📄 add.verilogview
0 B
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40
📄 fdwt_all-sim.vwf
63.79 KB
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41
📄 fdwt_all.fdwt_all.sgate_entries.csf.cdb
0 B
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42
📄 register_f.verilogview
0 B
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43
📄 counter_128bits.verilogview
0 B
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44
📄 chang3to2.verilogview
0 B
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45
📄 bidirec.verilogview
0 B
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46
📄 fdwt_all.verilogview
0 B
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47
📄 fdwt_all.psf.hdb
0 B
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48
📄 memory.verilogview
0 B
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49
📄 idwt97_control.verilogview
0 B
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50
📄 fdwt_all.ssf.msg
462 B
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