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MENTOR II  的通信参数配置：＃１４.０１：DP通讯地址       ＃０７.１１～＃０７.１５：设置为０        ＃０８.１２～＃０８.２０：设置为０，＃０８.２ ...

mmmmmmmmmxxx 2014-12-24 104 次 105 K

SmartPro MENTOR 组态图解

随着 EDA  设计的蓬勃发展，加之高速器件的大面积应用，单板的密度越来越大，提高 PCB单板的设计效率，已经成为我们亟待解决的问题。而 PCB 单机布线所花费的时间往往成为制约某一项目进度的瓶颈，为大幅度提高单板整体设计效率，使用 MENTOR 公司的 ExpeditionPCB 布线 ...

dcf866553 2014-12-24 128 次 772 K

MENTOR 测试点自动

这些术语支持Mentor Graphics PCB产品文档在术语表当中，一些是Mentor Graphics PCB产品独有的，另外一些是PCB行业标准。

lu2008 2013-11-09 170 次 792 K

Mentor 术语大全

  本练习将通过 PCB 布局，布线，信号完整性仿真分析，修改原理图添加器件等一系列的操作，使您熟悉Mentor ISD2004 系列板级仿真设计工具。

zhlee 2013-11-06 181 次 6129 K

Expedtion Mentor PCB 信号完整性

  One of the strengths of Synplify is the Finite State Machine compiler. This is a powerfulfeature that not only has the ability to automatic ...

robinmilk 2013-10-23 141 次 134 K

Synplicity Machine Verilog Design

本文简单探讨了verilog HDL设计中的可综合性问题，适合HDL初学者阅读   　　用组合逻辑实现的电路和用时序逻辑实现的　　电路要分配到不同的进程中。　　不要使用枚举类型的属性。　　Integer应加范围限制。　　通常的可综合代码应该是同步设计。 ...

sijieshenhua 2013-10-21 79 次 201 K

HDL 综合设计

  Finite state machines are widely used in digital circuit designs. Generally, when designing a state machine using an HDL, the synthesis too ...

z147028571a 2013-10-08 165 次 166 K

Creating Machines Mentor State