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VHDL/FPGA/Verilog 8194个

内有波形发生器

标签: 波形发生器发布者:zm250063191上传时间:2015-04-15
国外的VHDL应用例子

标签: VHDL 发布者:heyuyutu上传时间:2015-04-14
标准SDR SDRAM控制器参考设计

标签: SDRAM SDR 标准控制器发布者:linux_open_lab上传时间:2015-04-14
ZBT SRAM控制器参考设计

标签: SRAM ZBT 控制器参考设计发布者:NJ_WK上传时间:2015-04-14
PCI总线仲裁参考设计

标签: PCI 总线仲裁参考设计发布者:sunny_02上传时间:2015-04-14
I2C总线控制器 altera提供的VHDL的源程序代码

标签: altera VHDL I2C 总线控制器发布者:leeixndong上传时间:2015-04-14
可配置CRC参考设计 xilinx提供的VHDL

标签: xilinx VHDL CRC 可配置发布者:stone825上传时间:2015-04-14
IEEE 802.3 Cyclic Redundancy Check参考设计

标签: Redundancy Cyclic 802.3 Check 发布者:wzy1上传时间:2015-04-14
8051参考设计

标签: 8051 参考设计发布者:sheng_xia上传时间:2015-04-14
这是一个用MAX+PLUSII开发FPGA（1K30器件）开发的李沙育图形发生器（硬件描述语言部分）。

标签: PLUSII FPGA 1K30 MAX 发布者:xushenghao001上传时间:2015-04-14
基于fpga的逻辑分析仪可显示八路波形

标签: fpga 逻辑分析仪波形发布者:superdavid上传时间:2015-04-14
ALTERA NIOS处理器

标签: ALTERA NIOS 处理器发布者:WUYUEASDF上传时间:2015-04-13
ALTERA NIOS处理器实验

标签: ALTERA NIOS 处理器实验发布者:moxcki上传时间:2015-04-13
ALTERA　NIOS处理器实验

标签: ALTERA NIOS 处理器实验发布者:pipiooxx上传时间:2015-04-13
4位电子密码锁

标签: 电子密码锁发布者:jill上传时间:2015-04-13
Configurable cpu core that supports Z80, 8080 and gameboy instruction sets

标签: Configurable instruction supports gameboy 发布者:Kunlun_mrpii上传时间:2015-04-13
我从一本书上抄来的但用MAX+PLUSII编译有些问题初学者见谅

标签: PLUSII MAX 编译初学者发布者:xhaibo上传时间:2015-04-13
用vhdl的4x4的数据选择器

标签: vhdl 4x4 数据选择器发布者:wuweixiong123上传时间:2015-04-13
CPLD的VerilogHDL总线代码,在EPM7128SLC84-10+Quartus4平台上运行通过.

标签: VerilogHDL Quartus CPLD 7128 发布者:asd66335065上传时间:2015-04-12
采用Verilog HDL设计

标签: Verilog HDL 发布者:red2years上传时间:2015-04-11
此设计采用Verilog HDL硬件语言设计,在掌宇开发板上实现. 将整个电路分为两个子模块

标签: Verilog HDL 硬件语言设计开发板发布者:wql507上传时间:2015-04-11
vhdl 实例通过实例学习vhdl 编程

标签: vhdl 编程发布者:flashlee2003200上传时间:2015-04-11
本文件解压后clock_time.vhd采用编程环境maxplusII

标签: clock_time maxplusII vhd 解压发布者:kens上传时间:2015-04-11
des加密算法的verilog语言的实现

标签: verilog des 加密算法语言发布者:jxyw163上传时间:2015-04-10
James Armstrong VHDL Design , source code

标签: Armstrong Design source James 发布者:liu2000dz上传时间:2015-04-10
介绍quartus IＩ　汉语教程

标签: quartus 汉语教程发布者:pc1667pc1667上传时间:2015-04-10
一個LCD燈的小程序。不是我寫的。我只負責了調試。適用在ACEXEP1K30QC208-3上。我跑了SIMULATOR

标签: SIMULATOR ACEXEP LCD 208 发布者:sheng_xia上传时间:2015-04-10
通过CPLD将8位并行数据转换为串行数据并可以采用I2C方式与其他器件连接

标签: CPLD I2C 8位并行数据发布者:rylzll上传时间:2015-04-10
http://www.edacn.net/cgi-bin/forums.cgi?forum=7&topic=9127下,则R3～R0的输出信号中会有一个为1,但我们还是是无法确定哪一个键被按下,必須要

标签: cgi-bin forums edacn forum 发布者:lujing200912345上传时间:2015-04-09
基于CPLD-FPGA的半整数分频器的设计

标签: CPLD-FPGA 整数分频器发布者:szjunhui899上传时间:2015-04-09