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一个时钟分频模块,in verilog hdl

VHDL/FPGA/Verilog 2 K 136 次下载 2013-12-19

资源详细信息

文件格式

RAR

文件大小

2 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2013-12-19 22:47

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136 次

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一个时钟分频模块,in verilog hdl - 资源详细说明

一个时钟分频模块,in verilog hdl

一个时钟分频模块,in verilog hdl - 源码文件列表

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