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VHDL/FPGA/Verilog
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实现了VHDL乘法器
实现了VHDL乘法器
VHDL/FPGA/Verilog
4 K
65 次下载
2016-08-21
资源详细信息
文件格式
RAR
文件大小
4 K
资源分类
VHDL/FPGA/Verilog
上传者
xiao11tian
发布时间
2016-08-21 00:52
下载统计
65
次
所需积分
2 积分
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实现了VHDL乘法器,8位乘法操作的完成
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