基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器 　　9.1.1 由系统功能描述时序关系 　　9.1.2 流程图的设计 　　9.1.3 系统功能描述 　　 - 免费下载

VHDL/FPGA/Verilog资源 文件大小：5 K

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基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器 　　9.1.1 由系统功能描述时序关系 　　9.1.2 流程图的设计 　　9.1.3 系统功能描述 　　9.1.4 逻辑框图 　　9.1.5 延时模块的详细描述及仿真 　　9.1.6 功能模块Verilog-HDL描述的模块化方法 　　9.1.7 输入检测模块的详细描述及仿真 　　9.1.8 计数模块的详细描述 　　9.1.9 可编程单脉冲发生器的系统仿真 　　9.1.10 可编程单脉冲发生器的硬件实现 　　9.1.11 关于电路设计中常用的几个有关名词

源码文件列表

📂 共 8 个源码文件 点击文件名可在线查看源代码

1 📄
one_pulse.v
大小: 3.12 KB
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2 📄
p_dly_2.v
大小: 1.38 KB
查看源码
3 📄
p_dly_2_test.v
大小: 748 B
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4 📄
one_pulse_test.v
大小: 1016 B
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5 📄
p_detect_test.v
大小: 891 B
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6 📄
p_dly_1_test.v
大小: 736 B
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7 📄
p_dly_1.v
大小: 1.22 KB
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8 📄
p_detect.v
大小: 1.04 KB
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