用verillog HDL 写的数字频率计.在实验箱上测试通过 - 免费下载

VHDL/FPGA/Verilog资源文件大小：13 K

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文件格式

RAR

所属分类

VHDL/FPGA/Verilog

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上传时间

2013-12-28 20:23

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13 K

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资源简介

用verillog HDL 写的数字频率计.在实验箱上测试通过

源码文件列表

📂 共 14 个源码文件点击文件名可在线查看源代码

1 📄

block2.bdf

2 📄

count.bsf

3 📄

block2.qpf

4 📄

suocun.bsf

5 📄

fenwei.bsf

6 📄

fenwei.v

7 📄

fenpin.v

8 📄

fenpin.bsf

9 📄

scan.v

10 📄

scan.bsf

11 📄

suocun.v

12 📄

dec.v

13 📄

count.v

14 📄

dec.bsf

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#verillog #HDL #数字频率计 #实验箱

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