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其中“music_rom”使用FPGA厂商提供的工具生成的

其中“music_rom”使用FPGA厂商提供的工具生成的，如Altera的Quartus II 及其宏功能生成的这些文件。另外，我们还希望实现以下功能： * 播放音乐时，在ROM的结尾处暂停所以我们将原来的程序的最后一行从

标签： music_rom FPGA 厂商

上传时间： 2016-07-04

上传用户：dbs012280
使用Quartus II设计FPGA的应用设计实例  “Example-b3-1uart_regssrc”目录下为设计源文件  “Example-b3-1uart_

使用Quartus II设计FPGA的应用设计实例  “\Example-b3-1\uart_regs\src”目录下为设计源文件  “\Example-b3-1\uart_regs\core”目录下为Altera的IP宏功能模块  “\Example-b3-1\uart_regs\sim\funcsim”目录下为功能仿真文件  “\Example-b3-1\uart_regs\sim\parsim”目录下为时序仿真文件  “\Example-b3-1\uart_regs\dev”目录下为工程文件（包含了约束、综合、布局布线的过程文件和结果文件）

标签： Example-b 61548 uart_regssrc Quartus

上传时间： 2016-07-18

上传用户：wlcaption
骏龙提供的最新quartus8.0的license

骏龙提供的最新quartus8.0的license，包括Quartus II 8.0，NIOS II 8.0（在Quartus II的license里面），DSP Builde 8.0，ModelSim-Altera 6.1g (Quartus II 8.0)，新Quartus II的license支持远程桌面访问的功能。

标签： quartus license 8.0

上传时间： 2013-12-28

上传用户：wcl168881111111
描述了一个用于微波传输设备的16QAM接收机解调芯片的FPGA实现,芯片集成了定时恢复、载波恢复和自适应盲判决反馈均衡器(DFE),采用恒模算法(CMA)作为均衡算法。芯片支持高达25M波特的符号速率

描述了一个用于微波传输设备的16QAM接收机解调芯片的FPGA实现,芯片集成了定时恢复、载波恢复和自适应盲判决反馈均衡器(DFE),采用恒模算法(CMA)作为均衡算法。芯片支持高达25M波特的符号速率,在一片EP1C12Q240C8(ALTERA)上实现,即将用于量产的微波传输设备中。

标签： FPGA QAM DFE CMA

上传时间： 2013-12-09

上传用户：chongcongying
有关UART的源程序

有关UART的源程序，基于Altera 的。很好用的，希望对大家有帮助

标签： UART 源程序

上传时间： 2016-08-14

上传用户：xwd2010
FPGA逻辑设计

FPGA逻辑设计，vhdl/verilog altera/xilinx 介绍

标签： FPGA 逻辑设计

上传时间： 2016-08-30

上传用户：qq1604324866
FPGA开发入门的Verilog HDL程序---流水灯,真实可用

FPGA开发入门的Verilog HDL程序---流水灯,真实可用，验证通过，工程环境为Altera Quartus

标签： Verilog FPGA HDL 程序

上传时间： 2016-09-01

上传用户：VRMMO
FPGA开发入门的Verilog HDL程序2---梁祝音乐播放,真实可用

FPGA开发入门的Verilog HDL程序2---梁祝音乐播放,真实可用，验证通过，工程环境为Altera Quartus II

标签： Verilog FPGA HDL 程序

上传时间： 2014-01-09

上传用户：Altman
Verilog 编写的网卡DM9000A的IP核

Verilog 编写的网卡DM9000A的IP核，altera公司寄的DE2系统中的源程序核

标签： Verilog 9000A 9000 DM

上传时间： 2016-09-17

上传用户：AbuGe
Verilog 编写的ISP1362的控制器IP核

Verilog 编写的ISP1362的控制器IP核，altera公司DE2系统中的源程序

标签： Verilog 1362 ISP IP核

上传时间： 2016-09-17

上传用户：稀世之宝039