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VHDL/FPGA/Verilog资源文件大小：389 K

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VHDL/FPGA/Verilog

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2016-07-18 10:38

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使用Quartus II设计FPGA的应用设计实例  “\Example-b3-1\uart_regs\src”目录下为设计源文件  “\Example-b3-1\uart_regs\core”目录下为Altera的IP宏功能模块  “\Example-b3-1\uart_regs\sim\funcsim”目录下为功能仿真文件  “\Example-b3-1\uart_regs\sim\parsim”目录下为时序仿真文件  “\Example-b3-1\uart_regs\dev”目录下为工程文件（包含了约束、综合、布局布线的过程文件和结果文件）

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📂 共 107 个源码文件点击文件名可在线查看源代码

1 📄

uart_regs.sim.rpt

大小: 11.63 KB

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