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VHDL/FPGA/Verilog Verilog module containing a synthesizable CRC function // * polynomial: (0 1 8) // * data width: 8

Verilog module containing a synthesizable CRC function // * polynomial: (0 1 8) // * data width: 8

https://www.eeworm.com/dl/663/346825.html

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VHDL/FPGA/Verilog FPGA的存储器代码的VHDL,verilog描述及测试代码

FPGA的存储器代码的VHDL,verilog描述及测试代码

https://www.eeworm.com/dl/663/348900.html

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verilog FPGA VHDL 存储器

VHDL/FPGA/Verilog FPGA VERILOG 用DCFIFO实现跨时钟域的数据传输

FPGA VERILOG 用DCFIFO实现跨时钟域的数据传输，已验证，直接可用

https://www.eeworm.com/dl/663/351810.html

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VERILOG DCFIFO FPGA 时钟域

其他  to use verilog code and c to translate a RGB bmp image(512*512) to a gray level image

to use verilog code and c to translate a RGB bmp image(512*512) to a gray level image

https://www.eeworm.com/dl/534/353420.html

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image 512 translate to

VHDL/FPGA/Verilog Verilog HDL 编写的CY7C68013 SLAVE FIFO接口程序

Verilog HDL 编写的CY7C68013 SLAVE FIFO接口程序，实际测试可用。可以直接跟上位机连接，传输数据。

https://www.eeworm.com/dl/663/353951.html

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Verilog C68013 68013 SLAVE

VHDL/FPGA/Verilog 8051core-Verilog FPGA的51单片机内核源代码!

8051core-Verilog FPGA的51单片机内核源代码!

https://www.eeworm.com/dl/663/358573.html

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core-Verilog 8051 FPGA 51单片机

VHDL/FPGA/Verilog SAP-1的硬體描述語言(使用Verilog語言)

SAP-1的硬體描述語言(使用Verilog語言)

https://www.eeworm.com/dl/663/359862.html

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Verilog SAP

嵌入式/单片机编程  使用verilog语言控制CPLD通过红外收发器进行红外通讯

使用verilog语言控制CPLD通过红外收发器进行红外通讯，其中simple.qpf为发送端的工程文件，recive文件夹中的recive.qpf是接收端工程文件

https://www.eeworm.com/dl/647/361250.html

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verilog CPLD 语言控制红外收发器

VHDL/FPGA/Verilog verilog写的数字频率计的显示模块,可以

verilog写的数字频率计的显示模块,可以

https://www.eeworm.com/dl/663/361325.html

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verilog 数字频率计显示模块

VHDL/FPGA/Verilog 这是用Verilog HDL写的可调占空比分频控制器

这是用Verilog HDL写的可调占空比分频控制器，可以挂在Avalon总线上使用

https://www.eeworm.com/dl/663/361490.html

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Verilog HDL 分频控制器

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