fdivision.cr.mti

来自「verilog分频器～时钟为50hmz」· MTI 代码 · 共 10 行

MTI
10 行
字号 
E:/modelsim/examples/fdivision_tb.v {1 {vlog -work work -novopt E:/modelsim/examples/fdivision_tb.v
Model Technology ModelSim SE vlog 6.1f Compiler 2006.05 May 12 2006
-- Compiling module fdivision
-- Compiling module fdivision_tb

Top level modules:
	fdivision_tb

} {} {}}

fdivision.cr.mti - 源码说明

本页面展示了「verilog分频器～时钟为50hmz」中的 fdivision.cr.mti 源码文件，采用 MTI 编程语言编写，共 10 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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