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VHDL/FPGA/Verilog
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用高速硬件语言VHDL设计的全功能数字钟
用高速硬件语言VHDL设计的全功能数字钟
VHDL/FPGA/Verilog
3 K
62 次下载
2016-12-26
资源详细信息
文件格式
RAR
文件大小
3 K
资源分类
VHDL/FPGA/Verilog
上传者
zhou28
发布时间
2016-12-26 10:48
下载统计
62
次
所需积分
2 积分
用高速硬件语言VHDL设计的全功能数字钟 - 资源详细说明
用高速硬件语言VHDL设计的全功能数字钟,经测试运行稳定
用高速硬件语言VHDL设计的全功能数字钟 - 源码文件列表
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1
clock.vhd
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