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Usart model in vhdl code

VHDL/FPGA/Verilog 7 K 194 次下载 2013-12-17

资源详细信息

文件格式

RAR

文件大小

7 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2013-12-17 15:14

下载统计

194 次

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2 积分

Usart model in vhdl code - 资源详细说明

Usart model in vhdl code

Usart model in vhdl code - 源码文件列表

本资源包含 4 个源码文件支持在线预览，点击文件名即可查看

1

tx_async.vhd

2

rx_async.vhd

3

scc.vhd

4

clock_gen.vhd

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