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用vhdl实现的分频器
用vhdl实现的分频器
VHDL/FPGA/Verilog
3 K
128 次下载
2016-06-01
资源详细信息
文件格式
RAR
文件大小
3 K
资源分类
VHDL/FPGA/Verilog
上传者
justsohappy
发布时间
2016-06-01 10:58
下载统计
128
次
所需积分
2 积分
用vhdl实现的分频器 - 资源详细说明
用vhdl实现的分频器,可产生任意对主时钟的分频,从而是实现不同频率pwm的控制
用vhdl实现的分频器 - 源码文件列表
本资源包含 1 个源码文件
支持在线预览,点击文件名即可查看
1
freqdivfinal.vhd
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