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VHDL/FPGA/Verilog
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用verilog实现了一个数字秒表的设计
用verilog实现了一个数字秒表的设计
VHDL/FPGA/Verilog
2 K
71 次下载
2015-11-15
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
zwaheron
发布时间
2015-11-15 00:13
下载统计
71
次
所需积分
2 积分
用verilog实现了一个数字秒表的设计 - 资源详细说明
用verilog实现了一个数字秒表的设计
用verilog实现了一个数字秒表的设计 - 源码文件列表
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1
数字跑表.txt
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