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VHDL/FPGA/Verilog
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一个用FPGA语言设计数字秒表的程序
一个用FPGA语言设计数字秒表的程序
VHDL/FPGA/Verilog
422 K
143 次下载
2013-12-22
资源详细信息
文件格式
ZIP
文件大小
422 K
资源分类
VHDL/FPGA/Verilog
上传者
xiaoexiao
发布时间
2013-12-22 22:22
下载统计
143
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