💻 关于verilog的各个基本模块的源代码 - 源码文件列表

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源码文件总数： 35 个
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序号
文件名
文件大小
操作
1
📄 alu.v
279 B
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2
📄 registertest.v
509 B
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3
📄 registerfile.v
3.41 KB
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4
📄 memorytest.v
5.13 KB
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5
📄 top_test.v
1.47 KB
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6
📄 mux_32.v
1.03 KB
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7
📄 top.v
620 B
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8
📄 decoder.v
2.14 KB
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9
📄 dff.v
207 B
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10
📄 registerfiletest.v
4.86 KB
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11
📄 alladdtest.v
341 B
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12
📄 ir.v
169 B
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13
📄 dfftest.v
284 B
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14
📄 mux_32test.v
19.27 KB
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15
📄 controltest.v
2.03 KB
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16
📄 datapath.v
1.75 KB
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17
📄 mux21_5.v
255 B
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18
📄 mux41_32.v
217 B
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19
📄 addtest.v
1.19 KB
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20
📄 transcript
0 B
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21
📄 alladd.v
201 B
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22
📄 memory.v
3.5 KB
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23
📄 mux21_5test.v
262 B
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24
📄 mux21_32.v
169 B
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25
📄 decodertest.v
727 B
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26
📄 zerostore.v
173 B
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27
📄 pc.v
347 B
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28
📄 control.v
2.76 KB
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29
📄 mux21_32test.v
261 B
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30
📄 register.v
1.3 KB
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31
📄 irtest.v
3.21 KB
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32
📄 alutest.v
801 B
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33
📄 mux41_32test.v
406 B
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34
📄 add.v
1.68 KB
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35
📄 pctest.v
286 B
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