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-- MAX+plus II - generated Memory Initialization File -- Copyright (C) 1988-2002 Altera Corporation -- Any megafunction design…
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CPLD采用CMOSEPROM、EEPROM、快闪存储器和SRAM等编程技术，从而构成了高密度、高速度和低功耗的可编程逻辑器件。cPCI总线
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-- megafunction wizard: %LPM_CONSTANT% -- GENERATION: STANDARD -- VERSION: WM1.0 -- MODULE: lpm_constant -- ===============…
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--SEL_ampl library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity sel_ampl is port ( k…
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--RSNAND library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity rsnand is port(r_in:in std_l…
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-- megafunction wizard: %LPM_ROM% -- GENERATION: STANDARD -- VERSION: WM1.0 -- MODULE: lpm_rom -- =========================…
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-- MAX+plus II - generated Memory Initialization File -- Copyright (C) 1988-2002 Altera Corporation -- Any megafunction design…
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--Key1模块 library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity key1 is port( kin:in std_log…
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-- megafunction wizard: %LPM_ROM% -- GENERATION: STANDARD -- VERSION: WM1.0 -- MODULE: lpm_rom -- =========================…
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--addr_a_f library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity addr_a_f is port( sel: i…
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testrom_inst : testrom PORT MAP( address => address_sig, inclock => inclock_sig, outclock => outclock_sig, q => q_…