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vhdl语言设计频率计

vhdl语言设计频率计，十进制加法器.运用maxplus2运行，

标签： vhdl 语言频率计

上传时间： 2013-12-22

上传用户：qwe1234
基于verilog的fir滤波器设计

基于verilog的fir滤波器设计，用的并行结构。在前面基础上加入四级流水（加法器，并行乘法器，乘法结果相加两级），通过验证。

标签： verilog fir 滤波器设计

上传时间： 2013-11-26

上传用户：liuchee
本设计是一个八位被除数除以四位除数

本设计是一个八位被除数除以四位除数，得到不超过四位的商的整数除法器。被除数、除数、商和余数都是无符号整数。

标签：

上传时间： 2017-02-03

上传用户：baiom
数字信号处理的fpga实现

数字信号处理的fpga实现，用VHDL编程设计加法器

标签： fpga 数字信号处理

上传时间： 2013-12-09

上传用户：tianyi223
VHDL编程一百例

VHDL编程一百例，包括加法器、乘法器、移位寄存器、奇偶校验器等。pdf格式的，仅供学习使用

标签： VHDL 编程

上传时间： 2017-03-01

上传用户：chfanjiang
Altera的FPGA

Altera的FPGA，设计的硬件除法器

标签： Altera FPGA

上传时间： 2017-03-13

上传用户：lhw888
一些接口电路的Verilog设计

一些接口电路的Verilog设计，主要包括IIC、PS2、矩阵键盘、RS232、还有一些基础试验的源代码如：除法器、多路选择器、加法器、减法器、8位优先编码器等。

标签： Verilog 接口电路

上传时间： 2013-12-21

上传用户：a3318966
步进电机控制

步进电机控制，直流电机控制，加法器，状态机等等经典的VHDL例子程序。

标签： 步进电机控制

上传时间： 2013-12-24

上传用户：aa17807091
1.通过键盘、LCD来进行超低功耗实验 2 在一段时间内

1.通过键盘、LCD来进行超低功耗实验 2 在一段时间内，如果用户没有进行按键操作，系统将进入“睡眠”－－低功耗状态 3 用户按键后，系统从低功耗状态转到正常的工作状态 4 在非低功耗状态下，程序接收键盘按键执行加法器操作(因为键盘和LCD限制不能实现复杂 5 的功能,如乘法、减法、除法等）.

标签： LCD 键盘超低功耗实验

上传时间： 2017-06-19

上传用户：GavinNeko
本设计采用AT89552单片机

本设计采用AT89552单片机，辅以必要的模拟电路，实现了一个基于直接数字频率合成技术(DDS)的正弦谊号发生器。设计中采用DDS芯片AD9850产生频率1KHZ~10MHZ范围内正弦波，采用功放AD811控制输出电压幅度，由单片机AT89S52控制调节步进频率1HZ。在此基础上，用模拟乘法器MC1496实现了正弦调制信号频率为1KHZ的模拟相度调制信号；用FPGA芯片产生二进制NRZ码,与AD9850结合实现相移键控PSK、幅移键控ASK、频移镇键FSK。

标签： 89552 AT 单片机

上传时间： 2014-12-05

上传用户：shus521