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FPGA里面的分频器相关资料...

📅 2016-03-29

vhdl语言编写的2分频器代码，简单易懂...

📅 2014-01-08

技术分频器。把时钟分为奇数个，好像我做出来是个通用的。...

📅 2014-01-20

EDA常用计数函数VHDL程序设计,基于VHDL的交通灯设计实例&分频器...

📅 2013-12-23

计数,定时器应用.拨码开关一次只选一个..393作分频器用...

📅 2014-01-07

VHDL分频器，利用分频比较错法，要实现K=324/28=8.3571428571...的分频周期为28，18个8分频和10个9分频循环，所以设一个０到２7的循环计数器，每当1、4、7、10、13、1...

📅 2013-11-29

用vhdl实现的分频器，可产生任意对主时钟的分频，从而是实现不同频率pwm的控制...

📅 2016-06-01

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太...

📅 2016-06-14

一个可实现多倍（次）分频器VHDL源代码设计...

📅 2014-01-27

一个基于CPLD/FPGA的半整数分频器的设计的文档资料...

📅 2016-07-13

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