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该模块为分频器，将1KHZ的时钟频率分频成每分钟一次的时钟频率事实上，该源码可以实现任意整数的分频，主要让N的值设置好相应的数字...

📅 2013-12-30

利用VHDL语言描述的5分频器（改变程序中m1,m2值，可作为任意奇数分频器）...

📅 2013-12-23

利用数控分频器设计硬件电子琴.硬件电子琴电路模块设计...

📅 2013-11-28

数控分频器的设计数控分频器的功能就是当在输入端给定不同输入数据时，将对输入的时钟信号有不同的分频比，例3的数控分频器就是用计数值可并行预置的加法计数器设计完成的，方法是将计数溢出位与预置数加载输入...

📅 2013-12-11

半整数分频器的设计请不要上传有版权争议的内容和木马病毒代码...

📅 2014-08-16

这是我在ISP编程实验中独立编写的一个采用行为描述方式实现的分频器，通过两个并行进程对输入信号CLK进行8分频，占空比为1:7...

📅 2017-01-19

基于FPGA的分频器,可以根据更改参数,实现不同倍数的分频....

📅 2014-11-18

利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23），用HEX3~H...

📅 2014-12-20

用VHDL写的一个5/8分频器,希望对刚学习VHDL的朋友有帮助...

📅 2014-01-12

fpga上实现的最小是0.5分频的任意分频器...

📅 2017-03-24

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