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一个全加器的systemc代码，包括模块的定义以及测试平台...

📅 2017-05-20

FPGA 开发板源码。芯片为Mars EP1C6F.VHDL语言。可实现一些基本的功能。如乘法器、加法器、多路选择器等。...

📅 2017-05-25

FPGA开发板配套Verilog HDL代码。芯片为Mars EP1C6F。是基础实验的源码。包括加法器、减法器、乘法器、多路选择器等。...

📅 2014-11-10

8位全加器的VHDL语言描述，有需要的顶一下。...

📅 2017-05-30

利用两个半加器来组成的全加器，是简单的vhdl语言入门...

📅 2017-06-09

用例化语句和case语句编写的全加器的VHDL描述。...

📅 2017-06-15

1位全加器可以进行1位的二进制码的加法想进行改进改为4位或8位的全加器代码...

📅 2017-06-21

用VHDL语言设计四位全加器，有低位进位和高位进位。...

📅 2013-12-26

这是一个基于嵌入式的利用硬件高级描述语言编写的全加器程序，可以满足二进制全加的功能。...

📅 2014-01-02

一位全加器源码实现了MAX及其一系列器件实现全加的功能...

📅 2013-12-25

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