功<b>分</b>器

介绍了各种分频器的设计

介绍了各种分频器的设计，VHDL描述。包括偶数分频器，奇数分频器，办整数分频器

标签： 分频器

上传时间： 2017-05-18

上传用户：haohaoxuexi
参数化分频器

参数化分频器，以5为例，能很方便的扩展到参数N

标签： 参数分频器

上传时间： 2017-05-25

上传用户：libenshu01
欧几里德算法：辗转求余　　原理: gcd(a,b)=gcd(b,a mod b)　　当b为0时,两数的最大公约数即为a　　getchar()会接受前一个scanf的回车符

欧几里德算法：辗转求余　　原理: gcd(a,b)=gcd(b,a mod b)　　当b为0时,两数的最大公约数即为a　　getchar()会接受前一个scanf的回车符

标签： gcd getchar scanf mod

上传时间： 2014-01-10

上传用户：2467478207
半整数分频器的实现（verilog）

半整数分频器的实现（verilog），本文以6.5分频为例！很实用的！

标签： verilog 整数分频器

上传时间： 2014-08-20

上传用户：pompey
此为EDA设计的分频器模块。可以实现三种不同的频率信号

此为EDA设计的分频器模块。可以实现三种不同的频率信号，可以通过使用者自由设置频率大小

标签： EDA 分频器模块频率信号

上传时间： 2013-12-22

上传用户：671145514
标签： Verilog 分频器 N倍奇数分频器.(Verilog) N_odd_divider.v / Verilog module N_odd_divider (

标签： Verilog 分频器 N倍奇数分频器.(Verilog) N_odd_divider.v / Verilog module N_odd_divider (

标签： Verilog N_odd_divider module 分频器

上传时间： 2014-01-12

上传用户：nanxia
分频器的vhdl描述

分频器的vhdl描述，在源代码中完成对时钟信号CLK的2分频,4分频,8分频,16分频

标签： vhdl 分频器

上传时间： 2014-01-16

上传用户：奇奇奔奔
数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性

数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性强。他可利用并行预置数的加法计数器和减法计数器实现。广泛应用于电子仪器、乐器等数字电子系统中。

标签： VHDL 数控分频器修改

上传时间： 2014-11-29

上传用户：1051290259
verilog实现的奇数分频器针对任何规模的奇数分频

verilog实现的奇数分频器针对任何规模的奇数分频

标签： verilog 分频器分频模

上传时间： 2017-06-19

上传用户：GavinNeko
分别用分频比交错法及累加器分频法完成非整数分频器设计。

分别用分频比交错法及累加器分频法完成非整数分频器设计。

标签： 分频分累加器整数

上传时间： 2014-01-01

上传用户：shus521