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VHDL/FPGA/Verilog This Verilog HDL description implements a UART Version 1.1 : Original Creation 2.1 : added commen
This Verilog HDL description implements a UART
Version 1.1 : Original Creation
2.1 : added comments
VHDL/FPGA/Verilog 基于Verilog-HDL的转子振动噪声电压峰值检测
基于Verilog-HDL的转子振动噪声电压峰值检测，值得学习啊，
VHDL/FPGA/Verilog （219）卷积编码的verilog hdl源代码,很有用的啊,
（219）卷积编码的verilog hdl源代码,很有用的啊,
系统设计方案 适合高速Viterbi译码器的hdl的设计与实现
适合高速Viterbi译码器的hdl的设计与实现
VHDL/FPGA/Verilog 用VERILOG HDL实现的任意 频率分频器源代码
用VERILOG HDL实现的任意 频率分频器源代码，是一个通用的程序
Internet/网络编程 IEEE standard Verilog HDL1364-2001.pdf Verilog 学习必备资料
IEEE standard Verilog HDL1364-2001.pdf
Verilog 学习必备资料
单片机开发 Verlog HDL 写得一款32路方波发生器
Verlog HDL 写得一款32路方波发生器，例子是4路可以自己加，相位可调，频率可调，占空比可调。具体参见readme.doc.此处只提供了源码包含顶层模块sgs32.v 子模块dds.v和pll设置模块altp.v及波形驱动文件
VHDL/FPGA/Verilog 用verilog HDL实现I2C Master Controller 的设计
用verilog HDL实现I2C Master Controller 的设计，包括主程序设计和测试程序设计
嵌入式/单片机编程 verilog_hdl语言的LCD12864控制程序
verilog_hdl语言的LCD12864控制程序
VHDL/FPGA/Verilog 基于verilog HDL的一个USB 1.1的IP 核
基于verilog HDL的一个USB 1.1的IP 核，内有详细文档说明。