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VHDL/FPGA/Verilog 用verilog编写的fir滤波器程序

用verilog编写的fir滤波器程序，开发环境可以用ise quartus或active hdl等

https://www.eeworm.com/dl/663/187035.html

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verilog fir 编写滤波器

VHDL/FPGA/Verilog 用Verilog语言实现信号发生器

用Verilog语言实现信号发生器，包括AM，FM,PM，ASK,PSK,FSK调制。

https://www.eeworm.com/dl/663/193383.html

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Verilog 语言信号发生器

VHDL/FPGA/Verilog ddr2 controller, verilog source code from xilinx

ddr2 controller, verilog source code from xilinx

https://www.eeworm.com/dl/663/194343.html

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controller verilog source xilinx

其他书籍  verilog硬件描述语言介绍,仅供学习之用

verilog硬件描述语言介绍,仅供学习之用

https://www.eeworm.com/dl/542/203802.html

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verilog 硬件描述语言

VHDL/FPGA/Verilog 基于Verilog的数码管模拟扫描程序

基于Verilog的数码管模拟扫描程序，分为两种显示方式，一种是数码管逐个显示，另一个是所有数码管一起显示。

https://www.eeworm.com/dl/663/223927.html

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Verilog 数码管扫描程序模拟

VHDL/FPGA/Verilog ALTERA关于CCD的一些verilog程序

ALTERA关于CCD的一些verilog程序，都通过运行无误的。

https://www.eeworm.com/dl/663/229200.html

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verilog ALTERA CCD 程序

VHDL/FPGA/Verilog verilog分频器～时钟为50hmz

verilog分频器～时钟为50hmz，波特率采用9600bps～

https://www.eeworm.com/dl/663/234234.html

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verilog hmz 50 分频器

操作系统开发  verilog 描述8051core参考学习用

verilog 描述8051core参考学习用

https://www.eeworm.com/dl/531/243517.html

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verilog 8051 core

VHDL/FPGA/Verilog verilog实现的数字滤波器

verilog实现的数字滤波器，用于fpga

https://www.eeworm.com/dl/663/249357.html

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verilog 数字滤波器

VHDL/FPGA/Verilog 自己编写的串口UART的接收Verilog模块

自己编写的串口UART的接收Verilog模块，支持中断和查询方式接收，对信号的畸变适应能力强。

https://www.eeworm.com/dl/663/251471.html

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Verilog UART 编写串口

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