cnt_a.v

来自「I2C的slave端程序,用于响应master端,并进行通信」· Verilog 代码 · 共 9 行

9 行

`timescale 1 ps / 1 ps
module cnt_a(reset,start,aclr);
input reset,start;
output aclr;
wire aclr;

assign aclr=(~reset)|start;

endmodule

cnt_a.v - 源码说明

本页面展示了「I2C的slave端程序,用于响应master端,并进行通信」中的 cnt_a.v 源码文件，采用 Verilog 编程语言编写，共 9 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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