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VHDL/FPGA/Verilog
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用VHDL语言实现8421码的十进制计数器
用VHDL语言实现8421码的十进制计数器
VHDL/FPGA/Verilog
170 K
41 次下载
2013-12-08
资源详细信息
文件格式
RAR
文件大小
170 K
资源分类
VHDL/FPGA/Verilog
上传者
linux_open_lab
发布时间
2013-12-08 22:17
下载统计
41
次
所需积分
2 积分
用VHDL语言实现8421码的十进制计数器 - 资源详细说明
用VHDL语言实现8421码的十进制计数器,状态变化0000->0001->0010->0011->0100->0101->0110->0111->1000->0000.循环往复。
用VHDL语言实现8421码的十进制计数器 - 源码文件列表
本资源包含 55 个源码文件
支持在线预览,点击文件名即可查看
1
count_deng.map.eqn
查看源码
2
count_deng.qpf
查看源码
3
count_deng.qws
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4
count_deng.fit.rpt
查看源码
5
count_deng.asm.rpt
查看源码
6
sim.cfg
查看源码
7
count_deng.map.summary
查看源码
8
count_deng.fit.eqn
查看源码
9
count_deng.done
查看源码
10
count_deng.flow.rpt
查看源码
11
count_deng.pin
查看源码
12
count_deng.tan.summary
查看源码
13
count_deng.fit.summary
查看源码
14
count_deng.vhd
查看源码
15
count_deng.map.qmsg
查看源码
查看完整源码列表 (共 55 个文件) →
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