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VHDL/FPGA/Verilog
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RTL 异步数据传送模块 用verilog HDL 语言描
RTL 异步数据传送模块 用verilog HDL 语言描述 输入为八比特数据
VHDL/FPGA/Verilog
3 K
176 次下载
2013-12-23
资源详细信息
文件格式
RAR
文件大小
3 K
资源分类
VHDL/FPGA/Verilog
上传者
pangbo888
发布时间
2013-12-23 16:01
下载统计
176
次
所需积分
2 积分
RTL 异步数据传送模块 用verilog HDL 语言描述 输入为八比特数据 - 资源详细说明
RTL 异步数据传送模块 用verilog HDL 语言描述 输入为八比特数据,执行操作后异步每比特输出。
RTL 异步数据传送模块 用verilog HDL 语言描述 输入为八比特数据 - 源码文件列表
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2
test_txsysrtl.v
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3
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