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实现USB接口功能的VHDL和verilog完整源代码

VHDL/FPGA/Verilog 255 K 198 次下载 2017-03-21

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文件格式

RAR

文件大小

255 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2017-03-21 00:24

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198 次

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实现USB接口功能的VHDL和verilog完整源代码 - 资源详细说明

实现USB接口功能的VHDL和verilog完整源代码

实现USB接口功能的VHDL和verilog完整源代码 - 源码文件列表

本资源包含 100 个源码文件支持在线预览，点击文件名即可查看

1

usiecrcdef.v

2

udevinouts.v

3

uvendorcmdinouts.v

4

uvendorcmdios.v

5

usiedplldef.v

6

udevconnections.v

7

usiedcddef.v

8

uvendorconnections.v

9

udevendpoints.v

10

usienrzidef.v

11

udevios.v

12

udevctldef.v

13

udevreadmux.v

14

usiepktdef.v

15

usb_tb_def.v

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