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16位快速加法器verilong实现
16位快速加法器verilong实现
VHDL/FPGA/Verilog
4 K
110 次下载
2014-01-01
资源详细信息
文件格式
RAR
文件大小
4 K
资源分类
VHDL/FPGA/Verilog
上传者
suroot2005
发布时间
2014-01-01 07:09
下载统计
110
次
所需积分
2 积分
16位快速加法器verilong实现 - 资源详细说明
16位快速加法器verilong实现,很值得一看~
16位快速加法器verilong实现 - 源码文件列表
本资源包含 1 个源码文件
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1
用verilog 实现一个16位超前进位加法器.txt
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