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VHDL/FPGA/Verilog
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vhdl语言实现的频率发生器
vhdl语言实现的频率发生器
VHDL/FPGA/Verilog
2 K
41 次下载
2013-12-24
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
arnoldzhw
发布时间
2013-12-24 15:16
下载统计
41
次
所需积分
2 积分
vhdl语言实现的频率发生器 - 资源详细说明
vhdl语言实现的频率发生器,可以产生不同的频率
vhdl语言实现的频率发生器 - 源码文件列表
本资源包含 1 个源码文件
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1
exp17.vhd
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