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利用CASE语句的3-8译码器,3个为数据输入,3个为控制端
利用CASE语句的3-8译码器,3个为数据输入,3个为控制端,分别为S1,S2,S3,输出数据为八位
VHDL/FPGA/Verilog
129 K
87 次下载
2017-01-23
资源详细信息
文件格式
RAR
文件大小
129 K
资源分类
VHDL/FPGA/Verilog
上传者
sunny_02
发布时间
2017-01-23 20:57
下载统计
87
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利用CASE语句的3-8译码器,3个为数据输入,3个为控制端,分别为S1,S2,S3,输出数据为八位 - 资源详细说明
利用CASE语句的3-8译码器,3个为数据输入,3个为控制端,分别为S1,S2,S3,输出数据为八位
利用CASE语句的3-8译码器,3个为数据输入,3个为控制端,分别为S1,S2,S3,输出数据为八位 - 源码文件列表
本资源包含 63 个源码文件
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1
decoder_3_8.vhd
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2
waveform1.vwf
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3
decoder_3_8.flow.rpt
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4
decoder_3_8.pof
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5
decoder_3_8.tan.summary
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6
decoder_3_8.tan.rpt
查看源码
7
decoder_3_8.qsf
查看源码
8
decoder_3_8.fit.smsg
查看源码
9
decoder_3_8.qpf
查看源码
10
decoder_3_8.vwf
查看源码
11
decoder_3_8.fit.summary
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12
decoder_3_8.map.rpt
查看源码
13
decoder_3_8.fit.rpt
查看源码
14
decoder_3_8.asm.rpt
查看源码
15
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