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VHDL/FPGA/Verilog
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技术分频器。把时钟分为奇数个
技术分频器。把时钟分为奇数个
VHDL/FPGA/Verilog
267 K
45 次下载
2014-01-20
资源详细信息
文件格式
RAR
文件大小
267 K
资源分类
VHDL/FPGA/Verilog
上传者
zhoujun008
发布时间
2014-01-20 04:35
下载统计
45
次
所需积分
2 积分
技术分频器。把时钟分为奇数个 - 资源详细说明
技术分频器。把时钟分为奇数个,好像我做出来是个通用的。
技术分频器。把时钟分为奇数个 - 源码文件列表
本资源包含 72 个源码文件
支持在线预览,点击文件名即可查看
1
div_js.flow.rpt
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2
div_js.pof
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3
div_js.vhd
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4
div_js.vwf
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5
div_js.tan.summary
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6
prev_cmp_div_js.qmsg
查看源码
7
div_js.qsf
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8
div_js.sim.rpt
查看源码
9
div_js.qpf
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10
div_js.fit.rpt
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11
div_js.map.summary
查看源码
12
div_js.tan.rpt
查看源码
13
div_js.fit.summary
查看源码
14
div_js.map.ecobp
查看源码
15
div_js.rtlv_sg.cdb
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