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VHDL/FPGA/Verilog
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实现对时钟信号的技术分频
实现对时钟信号的技术分频
VHDL/FPGA/Verilog
2 K
44 次下载
2013-12-26
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
dhgagfdagfdsdgf
发布时间
2013-12-26 12:19
下载统计
44
次
所需积分
2 积分
实现对时钟信号的技术分频 - 资源详细说明
实现对时钟信号的技术分频,程序简单易懂,对于初学VHDL者来说,提供了一个良好的方法。
实现对时钟信号的技术分频 - 源码文件列表
本资源包含 2 个源码文件
支持在线预览,点击文件名即可查看
1
clk_div.vwf
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2
clk_div.vhd
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