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用verilog编写的pci——rtl级。

VHDL/FPGA/Verilog 194 K 35 次下载 2015-06-06

资源详细信息

文件格式

RAR

文件大小

194 K

资源分类

VHDL/FPGA/Verilog

上传者

woainijiajia123

发布时间

2015-06-06 10:20

下载统计

35 次

所需积分

2 积分

用verilog编写的pci——rtl级。 - 资源详细说明

用verilog编写的pci——rtl级。

用verilog编写的pci——rtl级。 - 源码文件列表

本资源包含 10 个源码文件支持在线预览，点击文件名即可查看

1

pci_wbw_fifo_control.v

2

pci_delayed_write_reg.v

3

pci_conf_cyc_addr_dec.v

4

timescale.v

5

pci_wb_slave_unit.v

6

pci_wb_master.v

7

pci_wb_addr_mux.v

8

pci_io_mux_ad_en_crit.v

9

pci_pci_decoder.v

10

pci_in_reg.v

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