💻 用VERILOG实现的秒表 用VERILOG实现的秒表 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 secondwatch.map.summary
440 B
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2
📄 secondwatch.map.rpt
44.81 KB
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3
📄 7seg.v.bak
327 B
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4
📄 secondwatch.tan.rpt
64 KB
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5
📄 secondwatch.qws
1.17 KB
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6
📄 secondwatch.qpf
911 B
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7
📄 secondwatch.sof
0 B
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8
📄 rlshifter.v.bak
233 B
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9
📄 secondwatch.pin
29.62 KB
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10
📄 fd_iii_pins.csv
5.18 KB
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11
📄 secondwatch.qsf.bak
1.6 KB
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12
📄 secondwatch.merge.rpt
11.01 KB
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13
📄 4mux.v
329 B
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14
📄 secondwatch.map.smsg
17.56 KB
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15
📄 8count.v.bak
444 B
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16
📄 secondwatch.flow.rpt
5.15 KB
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17
📄 top_fd_iii.v
3.03 KB
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18
📄 secondwatch_modelsim.xrf
16.45 KB
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19
📄 secondwatch_v.sdo
64 KB
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20
📄 secondwatch.vo
64 KB
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21
📄 16count.v.bak
1.19 KB
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22
📄 secondwatch.qsf
9.31 KB
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23
📄 secondwatch.fit.summary
416 B
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24
📄 8count.v
481 B
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25
📄 secondwatch.eda.rpt
5.18 KB
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26
📄 16count2.v
799 B
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27
📄 rlshifter.v
251 B
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28
📄 fenpin.v
4.33 KB
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29
📄 secondwatch_nativelink_simulation.rpt
1.7 KB
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30
📄 4mux.v.bak
275 B
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31
📄 16count.v
1.13 KB
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32
📄 secondwatch.pof
0 B
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33
📄 secondwatch.fit.smsg
16.67 KB
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34
📄 secondwatch.done
26 B
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35
📄 secondwatch.rtlv_sg_swap.cdb
0 B
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36
📄 secondwatch.cmp_bb.cdb
0 B
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37
📄 secondwatch.(3).cnf.hdb
0 B
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38
📄 secondwatch.sld_design_entry_dsc.sci
0 B
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39
📄 secondwatch.cmp.hdb
0 B
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40
📄 secondwatch.(1).cnf.cdb
0 B
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41
📄 secondwatch.(8).cnf.cdb
0 B
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42
📝 secondwatch.cbx.xml
225 B
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43
📄 secondwatch.asm.qmsg
1.76 KB
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44
📄 secondwatch.sld_design_entry.sci
0 B
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45
📄 secondwatch.cmp0.ddb
0 B
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46
📄 secondwatch.eco.cdb
0 B
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47
📄 secondwatch.map_bb.cdb
0 B
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48
📄 secondwatch.cmp.cdb
0 B
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49
📄 secondwatch.(6).cnf.hdb
0 B
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50
📄 secondwatch.cmp_bb.rcf
0 B
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