2.045MHz时钟信号

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  标签： clk 电子闹钟 标准 时钟信号

  上传时间： 2017-01-02

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• 提供I2C总线初始化、工作时的启始位、结束位、提供I2C总线的时钟信号免费下载

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  标签： I2C 总线 初始化 时钟信号

  上传时间： 2015-03-15

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• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF

  标签： 数据 Q5 PLL 输入

  上传时间： 2014-06-08

  上传用户：daguda

• 开发系统上采用的时钟信号的频率是20MHz免费下载

  资源简介：开发系统上采用的时钟信号的频率是20MHz，可分别设计计数器对其计数，包括计秒、分、小时、日、周、月以及年等。在每一级上显示输出，这样就构成了一个电子日历和时钟的模型。为了可以随意调整计数值，还应包含设定计数初值的电路

  标签： MHz 20 开发系统 时钟信号

  上传时间： 2014-07-30

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• 电话计费器程序/*信号定义： clk： 时钟信号免费下载

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  标签： clk 电话计费器 信号 定义

  上传时间： 2014-01-15

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• 用ＭＡＴＬＡＢ产生各种时钟信号免费下载

  资源简介：用ＭＡＴＬＡＢ产生各种时钟信号，对于不同的模块产生适当的始终信号．

  标签： 时钟信号

  上传时间： 2014-01-06

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  标签： MAXPLUS2 D触发器 触发器 时钟信号

  上传时间： 2014-01-17

  上传用户：lizhizheng88

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  标签： uVision2 Keil C51 ADC

  上传时间： 2013-12-17

  上传用户：lo25643

• cpu时钟信号控制程序编制免费下载

  资源简介：cpu时钟信号控制程序编制

  标签： cpu 时钟信号 控制 程序

  上传时间： 2014-01-22

  上传用户：zsjinju

• UART 处理的是并行数据转换为串行信号和串行信号转换为并行数据。现有的时钟不精确,这就需要用一个远高于波特率的本地时钟信号对输入信号不断采样,以不断让接收器与发送器保持同步。免费下载

  资源简介：UART 处理的是并行数据转换为串行信号和串行信号转换为并行数据。现有的时钟不精确,这就需要用一个远高于波特率的本地时钟信号对输入信号不断采样,以不断让接收器与发送器保持同步。

  标签： UART 并行数据 串行信号 转换

  上传时间： 2014-09-03

  上传用户：xcy122677

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  资源简介：用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.

  标签： 电路模块 VHDL 数字频率计 信号

  上传时间： 2016-06-04

  上传用户：ls530720646

• 本程序为模拟可校时的时钟程序；clk--时钟信号,rst--清零信号,set_en--校时 使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校 时免费下载

  资源简介：本程序为模拟可校时的时钟程序；clk--时钟信号,rst--清零信号,set_en--校时 使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校 时,（hh,hl,ml,mh,sh,sl）--时，分，秒显示信号。 校时的时候，秒清零。

  标签： faster set_en slower 信号

  上传时间： 2013-12-06

  上传用户：x4587

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  资源简介：时钟发生器 clkgen 利用外来时钟信号clk 来生成一系列时钟信号clk1、fetch、alu_clk 送往CPU的其他部件

  标签： alu_clk clkgen fetch clk1

  上传时间： 2014-01-16

  上传用户：gdgzhym

• 其内容有： 1.基带输入波形及其功率谱 2.QPSK调制信号及其功率谱 3.AWGN信道输出及其功率谱 4.通过瑞利信道之前和之后的信号星座图 5.在高斯白噪声和瑞利衰落信道条件下免费下载

  资源简介：其内容有： 1.基带输入波形及其功率谱 2.QPSK调制信号及其功率谱 3.AWGN信道输出及其功率谱 4.通过瑞利信道之前和之后的信号星座图 5.在高斯白噪声和瑞利衰落信道条件下的误码性能以及高斯白噪声的理论曲线，所有误码性能曲线在同一坐标比例下绘制

  标签： QPSK AWGN 功率谱 信道

  上传时间： 2016-06-14

  上传用户：dancnc

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  标签： 时钟信号 输入端

  上传时间： 2016-07-15

  上传用户：凌云御清风

• 时钟信号输入端免费下载

  资源简介：时钟信号输入端，要求编制一个顶层文件，产生具有自动加一功能的地址加法器

  标签： 时钟信号 输入端

  上传时间： 2016-07-15

  上传用户：钓鳌牧马

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  资源简介：用层次化设计完成倒计时装置 输入：16位二进制倒计时起始数字、倒计时起始数字的输入使能信号、 倒计时开始信号、复位信号、1MHz时钟信号、10Hz时钟信号。 输出：数码管数据信号及宣统信号，倒计时结束信号。

  标签： 计时 信号 1MHz 数字

  上传时间： 2016-07-19

  上传用户：xuan‘nian

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  标签： I2C SCL 通讯 IO口

  上传时间： 2016-08-21

  上传用户：ljmwh2000

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  标签： FLASH 8051 020 ISP

  上传时间： 2014-01-02

  上传用户：huyiming139

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  标签： Msdram 5509a SDRAM dsp

  上传时间： 2016-09-26

  上传用户：bjgaofei

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  标签： 1302 DS 编程 时钟信号

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  标签： 单片机 时钟信号 操作 基准

  上传时间： 2016-11-28

  上传用户：WMC_geophy

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  资源简介：通过一个主时钟信号完成异步FIFO读写时钟信号的产生。编译通过实现功能。

  标签： FIFO 主时钟 信号 读写

  上传时间： 2017-03-28

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• 三分频程序,对输入的时钟信号进行分频免费下载

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  标签： 三分频 程序 时钟信号 分频

  上传时间： 2014-01-12

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  标签： 时钟信号 分频

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  资源简介：用4位十进制计数器对用户输入时钟信号进行计数，计数间隔为1秒钟。计数满1秒钟后将计数值（即频率值）所存到4位寄存器中显示，并将计数器清0，在进行下一次计数。 频率计由三种模块组成：testctl为控制模块，由1Hz其准产生rst_cnt,load,cnt_en信号；cnt10为...

  标签： 十进制计数器 信号 用户 输入时钟

  上传时间： 2013-12-25

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  标签： FLASH 8051 020 ISP

  上传时间： 2017-07-03

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  标签： Q5 数据 PLL 输入

  上传时间： 2017-07-24

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• C8051F020/1/2/3 混合信号ISP FLASH 微控制器 数 据 手 册 潘 琢 金 译免费下载

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  标签： FLASH 8051 020 ISP

  上传时间： 2017-07-29

  上传用户：徐孺

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  资源简介：本程序演示从P3.4、P3.5和P1.0输出时钟信号。使用18.432MHz的晶振和STC12C5AXXS2系列单片机，从两个定时器引脚以及独立波特率发生器分别输出频率为150k、200k和100k赫兹的矩形波。内有C语言和汇编语言，用Keil C编译。

  标签： 18.432 5AXXS AXXS2 AXXS

  上传时间： 2014-08-28

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