testbench
testbench是一种验证的手段。首先，任何设计都是会有输入输出的。但是在软环境中没有激励输入，也不会对你设计的输出正确性进行评估。那么此时便有一种，模拟实际环境的输入激励和输出校验的一种“虚拟平台”的产生。在这个平台上你可以对你的设计从软件层面上进行分析和校验，这个就是testbench的含义。
资源总数
84
testbench 全部资料 84 份
Writing Testbenches classic book in verilog testbench
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2014-08-03
185
Simple shift register with testbench in vhdl
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2017-08-20
185
UART Transmitter. VHDL code and its testbench.
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2017-08-30
88
Shift Register. VHDL code and its testbench.
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2013-12-18
175
DAC converter design with Verilog code and testbench
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2014-01-23
160