分频功率全部资料下载-10476个分频功率技术资源-虫虫下载站

Verilog 实现9999计数，内有分频模块，计数模块，译码，动态显示扫描等，用数码显示，...

📅 2016-03-30

[VHDL经典设计26例]--在xilinx芯片上调试通过--[01--1位全加器][02--2选1多路选择器][03--8位硬件加法器][04--7段数码显示译码器][05--8位串入并出寄存器][...

📅 2014-09-06

本示例中使用了一个DCM模块，将输入时钟50MHz，倍频到100MHz，分频到25MHz，不同的频率值通过LED进行演示。...

📅 2014-07-07

PROTEUS仿真用单片机系统板系统资源丰富： ★　内置RAM　32KB模块 ★　内置8位动态数码显示模块 ★　内置8X8点阵显示模块 ★　4位静态数码显示模块 ★　4位级联的74LS1...

📅 2014-08-17

利用verilog语言，设计分频器，很不错的参考资料...

📅 2013-12-03

基于DE2实验板，Quartus6.0开发环境，驱动两行液晶，其中分频值可以设置的更小一些，调试成功，编译下载即可。...

📅 2016-06-12

2MHz的数据时钟恢复电路，包括鉴相器、分频器及滤波器...

📅 2013-12-26

该程序实现跑马灯效果,跑马灯共4个状态循环显示，本程序只使用了4个LED显示，可改变程序中的输出位数，增加显示位数。 INT_DIV 模块用于对主频进行分频，该实验中采用主频为50MHz的频率，进过...

📅 2014-12-08

该程序实现一个频率计，测量范围：1-49999999赫兹，用8为数码管扫描显示出被测信号的频率。 INT_DIV模块用于对系统的频率进行分频，此模块的输出信号为被测信号的频率，可以自己设定分频系数，...

📅 2013-12-30

本文件包括多路选择器器建模，译码器实验程序，加法器实验程序，比较器实验程序，计数器建模，I2C接口标准建模源码，串行接口RS232标准建模源码标准，LCM建模源码，时钟６分频源码，串并转化源码。，...

📅 2014-01-21

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