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VHDL/FPGA/Verilog
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利用verilog语言
利用verilog语言
VHDL/FPGA/Verilog
284 K
117 次下载
2013-12-03
资源详细信息
文件格式
RAR
文件大小
284 K
资源分类
VHDL/FPGA/Verilog
上传者
wuqunzhen
发布时间
2013-12-03 13:37
下载统计
117
次
所需积分
2 积分
利用verilog语言 - 资源详细说明
利用verilog语言,设计分频器,很不错的参考资料
利用verilog语言 - 源码文件列表
本资源包含 81 个源码文件
支持在线预览,点击文件名即可查看
1
fen_pin_10_1.qws
查看源码
2
enable.v
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3
fen_pin_10_1.map.rpt
查看源码
4
couter10.v
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5
fen_pin_10_1.eda.rpt
查看源码
6
counter10.bsf
查看源码
7
fen_pin_10_1.tan.rpt
查看源码
8
enable.bsf
查看源码
9
fen_pin_10_1.fit.smsg
查看源码
10
fen_pin_10_1.done
查看源码
11
fen_pin_10_1.map.summary
查看源码
12
counter11.v
查看源码
13
fen_pin_10_1_v.sdo
查看源码
14
fen_pin_10_1.vo
查看源码
15
fen_pin_10_1_modelsim.xrf
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